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三维结构电磁场仿真软件的快速入门

作者:易发棋牌最新网站 发布时间:2020-10-08 07:50 点击数:

  HFSS全称 high frequency structural simulator,其创始人是卡内基梅隆大学(Carnegie Mellon University)大学教授Prof. Zoltan J. Cendes,他在加拿大麦吉尔大学(McGill University)念的硕士和博士,重点研究基于有限元的电磁计算。1973年博士毕业后,他入职美国纽约通用公司,干了六年后回到母校麦吉尔大学当副教授,1982年转到卡内基梅隆大学担任教授,1984年创立了Ansoft公司(Analysis Software简称)。1988年,鼎鼎有名的惠普公司(HP, Hewlett-Packard Corporation)找到他们进行合作,签订合同,要求Ansoft负责开发出一款电磁仿真软件,即HFSS,产品成熟后转交HP进行销售,Ansoft公司从中获得版权收益(注此时Ansoft公司很小很小,市场份额几乎为零,此举极有利于公司发展壮大)。1990年,HP-HFSS正式发布(注此时HFSS属HP)。1999年,安捷伦(Agilent)从HP公司分离,HP-HFSS相应变为Agilent-HFSS。2001年,Ansoft公司又从Agilent手中成功收购会HFSS,改名Ansoft-HFSS。2006年,Ansys公司又成功收购Ansoft公司(8.32亿美元),改名Ansys-HFSS,这就是大家现在经常用到的HFSS的前世今生(国内简称HFSS为海飞丝)。

  HFSS作为世界上第一款商业化的三维结构电磁场仿真软件,被公认为三维电磁场设计和分析的工业标准,评价和地位非常之高。创始人Prof. Zoltan J. Cendes在2014年的一次访谈中指出,HFSS的先进性主要得益于两点,一是高效的自动有限元网格生成,二是精确的有限元近似求解。

  首先是对仿真目标进行几何建模,然后进行网格剖分,再通过有限元精确求解得到电场分布,最后进行后处理,得到有用的频域响应。从数值计算角度来说,对目标进行网格剖分越密集,求解精度越高,但与此同时,计算量也随之显著增加,为此HFSS引入自适应网格剖分技术,如下图所示,

  首先程序会对仿真目标进行一个粗略的网格剖分(大量的小四面体),并进行有限元近似求解,同时计算出每个剖分单元的近似误差(因为对电场是近似求解),然后计算出目标频率响应(例如S参数)。按道理说,结果已经得到,仿真就可以结束了,但是HFSS说不行!还要进一步验证当前仿真的精度,为此HFSS选择那些近似误差较大的剖分单元进行加密,然后重新仿真计算,再次得到新的目标频率响应,并与上次的仿真结果进行对比,如果两者结果相差较大(例如相对误差大于2%),说明上次网格剖分质量还有待提高,因此需要加密网格剖分,继续验证对比,直到仿真结果趋向一致,这就是所谓的自适应网格剖分技术。

  关于有限元算法的原理和实现,难度较大,不推荐大家深入学习,只需要简单了解一些基本的知识即可,比如有限元是从矢量亥姆赫兹方程出发,对电场进行基函数分解,然后在进行三维体积分,得到目标矩阵方程,如下所示

  特别的,有限元学习时要与矩量法的原理进行区分,矩量法是基于面剖分,对表面电流进行基函数分解,然后再进行面积分得到目标矩阵方程。由于基函数选取和目标方程不同,有限元法在处理电大问题上具有显著优势。

  最后,简单介绍一下HFSS在求解器分类,按照官网给出的建议,HFSS三类求解器应用场合如下

  但实际上,除了本征模求解器应用场合比较明确以外,模式驱动(Driven Model)和终端驱动(DrivenTeminal)的应用一直容易让用户产生疑惑,这里不做过多讨论,建议大家参考官方给出的例子进行操作,不要过多纠结(如果实在想搞清楚,建议从算法实现层面去探究)。

  HFSS在软件设计上采用了经典的树型导航,其界面主要包括菜单工具栏、项目管理栏、属性窗、消息窗、进度窗以及建模视图窗。

  HFSS仿真主要包括建立模型、定义边界、施加激励、设置求解、扫描频率和后处理六个步骤。

  根据仿真目标的几何属性和材料特性,选择Modeler-》Units设置单位,再在工具栏中选择对应几何物理进行建模,可选择参数化建模(Local Variable,在Design Properties中可以查看)。

  HFSS仿真时一般需要画一个空气盒子,把仿真目标全部包含在内,然后再在空气盒子的外表面设置辐射边间(或吸波边界)。这是因为HFSS仿真背景空间默认为PEC边界!对于仿真目标,则根据具体需求设置对应边界。

  除本征模分析以外,其它频域仿真都需要外加激励(空间场/波端口/集总端口),特别在应用波端口激励时,需要定义积分线(方便定义模式和等效电压),当求解模式为终端驱动时,还需要注意参考地的设置。

  仿真前需要由用户指定求解器工作模式(也可在第一步建模前设置)和工作频点(用于网格剖分,可设置为最高频点),并定义仿真结束条件(最大仿真次数和误差标准),然后以此为基准开展自适应网格剖分和迭代求解。

  仿真启动后,HFSS首先在工作频点处开展仿真,得到满足要求的高质量网格剖分,然后以此网格剖分为标准对用户感兴趣的频率范围进行仿真(此时无需自适应网格剖分)。

  根据求解器的类型和用户的需求,HFSS可提供种类众多的可视化结果,包括S参数、阻抗特性曲线、表面电流分布、空间场分布等等。

  总的来说,与CST相比,HFSS在仿真精度和能力方面具有绝对的优势,但在软件设计方面还有很大差距,帮助针对性不强、选项设置过多、操作设置过繁,因此HFSS总是让人“爱横交织”。对于初学者,建议先以熟悉HFSS操作为主(按照官方教程反复操作),然后再开始仿线) 技巧讨论

  做过电磁仿真的人都有体会,电磁仿真有相当部分时间是用在建模上面的。因此有必要熟悉软件的快捷键,在提高工作效率的同时,体会软件操作的快感,HFSS建模时常用的快捷键如下

  HFSS提供的边界条件高达数十种,其实经常用的也就三种,一是理想导电/导磁边界,二是开放边界,三是集总加载边界,分别如下图所示

  关于外加激励,设置最为复杂的当属波导端口激励,一方面需要考虑激励面积大小,另一方面需要考虑模式分布,而且当求解模式不同时,波导的参考阻抗设置也有不同,这个大家要多多参考HFSS的官方教程和文档。

  最后,关于扫频的三个选项:快速、离散和插值,其实就是仿真效率和精度的权衡,如果工程仿真时间很短,建议全部采用离散频率扫描(真实仿真结果);否则,则根据具体情况择优选择快速或插值。

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  MC10E116 Quint差分线是一款带有射极跟随器输出的五阶差分线路接收器。对于要求带宽大于E116的应用,可能会对E416器件感兴趣。 有源电流源加上MOSAIC III工艺的深度集电极特性为接收器提供了出色的共模噪声抑制。每个接收器都有一个专用的V CCO 电源引线,提供最佳的对称性和稳定性。 如果反相和非反相输入的电位均等于-2.5 V,则接收器没有达到规定的状态,而是以正常的差分放大器方式进行电流共享,在HIGH和LOW之间产生输出电压电平,或者器件甚至可以振荡。 V BB 引脚,内部产生的电源,仅适用于此器件。对于单端输入条件,未使用的差分输入连接到V BB 作为开关参考电压。 V BB 也可以重新连接AC耦合输入。使用时,通过0.01 F电容去耦V BB 和VCC,并限制电流源或吸收至0.5 mA。不使用时,V BB 应保持打开。 100系列包含温度补偿。 特性 500ps最大。传播延迟 V BB 供应输出 每个接收器的专用V CCO 引脚 PECL模式工作范围:V CC = 4.2 V至5.7 V,V EE = 0 V NECL模式工作范围:V CC = 0 V,V EE = -4.2 V至-5.7 V 输入Q s 在...

  MC100EP116 差分线位差分线路接收器。高频输出提供的3.0GHz带宽使该器件非常适合缓冲超高速振荡器。 V BB 引脚,内部产生的电压源,可用于此仅限设备。对于单端输入条件,未使用的差分输入连接到V BB 作为开关参考电压。 V BB 也可以重新连接AC耦合输入。使用时,通过0.01uF电容去耦V BB 和V CC ,并将电流源或吸收限制在0.5 mA。不使用时,V BB 应保持开路。 该设计在器件内部集成了两级增益,使其成为高带宽放大器应用的理想选择。 差分输入具有内部钳位结构,这将强制栅极的Q输出在开路输入条件下进入低电平状态。因此,未使用的门的输入可以保持打开,并且不会影响设备其余部分的操作。请注意,只有当两个输入均低于V CC 2.5V时,输入钳位才会生效。 100系列包含温度补偿。 特性 260 ps典型传播延迟 最高频率

  3 GHz典型 PECL模式工作范围:V CC = 3.0 V至5.5 V,V EE = 0 V NECL模式工作范围:V CC = 0 V,V EE = -3.0 V至-5.5 V 打开输入默认状态 输入的安全钳位 Q输出打开或V EE 时输出默认...

  信息 MC10E / 100E116是一款带有射极跟随器输出的五阶差分线路接收器。对于要求带宽大于E116的应用,可能会对E416器件感兴趣。有源电流源加上MOSAIC III工艺的深度集电极特性可为接收器提供出色的共模噪声抑制。每个接收器都有一个专用的V 电源引线,提供最佳的对称性和稳定性。如果反相和非反相输入均为

  -2.5 V的相等电位,则接收器不会进入定义状态,而是正常差分放大器方式的电流共享,在高电平和低电平之间产生输出电压电平,或者器件甚至可能振荡。 V 引脚,内部产生的电压源,仅适用于此器件。对于单端输入条件,未使用的差分输入连接到V 作为开关参考电压。 V 也可以重新连接AC耦合输入。使用时,通过0.01 F电容去耦V 和VCC,并限制电流源或吸收至0.5 mA。不使用时,V 应保持打开状态。 100系列包含温度补偿。 500ps Max。传播延迟 V 电源输出 专用V 每个接收器的引脚 PECL模式工作范围:V = 4.2 V至5.7 V,V = 0 V NECL模式工作范围:V = 0 V当V = -4.2 V至-5.7 V 输出Q 将在输入 内部输入下拉电阻时默认为低电平 符合或超过JEDEC规范EIA / JESD78 IC闩锁测试 ESD保护:...

  和特点 接收器输入引脚提供±15 kV ESD保护开关速率:400 Mbps(200 MHz)流通引脚配置简化印制电路板布线 ps(典型值) 差分偏移:100 ps(典型值) 传播延迟:2.7 ns(最大值)电源电压:3.3 V断电时具有高阻抗输出低功耗设计(待机功耗典型值为3 mW)可与现有的5 V LVDS驱动器配合使用接收小摆幅(典型值310 mV )差分输入信号电平支持开路、短路,以及终止输入故障安全 产品详情 ADN4668是一款四通道CMOS低压差分信号(LVDS)线 MHz)以上的数据速率及超低功耗。ADN4668具有流通引脚配置,可以轻松实现印制电路板布线以及输入信号与输出信号的分离。这款器件接收低压(典型值310 mV)差分输入信号,并将其转换为单端3 V TTL/CMOS逻辑电平。ADN4668还提供高电平有效和低电平有效的启用/禁用输入(EN 和/EN),以控制全部的4个接收器。它们可禁用接收器,并将输出切换为高阻抗状态。这个高阻抗状态允许对一个或多个ADN4668的输出进行多路复用,以将待机功耗降低至3 mW(典型值)。ADN4668及与其配合使用的驱动器ADN4667,可为高速点对点数据传输提供全新的解决...

  和特点 输入引脚提供±15 kV ESD保护转换速率:400 Mbps (200 MHz)直通式引脚排列可简化PCB布局传播延迟:2.5 ns(最大值)3.3 V 电源关断时为高阻抗输出与现有5 V LVDS驱动器兼容接受小摆幅(典型值310 mV)差分信号电平支持开路、短路和端接输入故障安全功能阈值区间:0 V至−100 mV符合TIA/EIA-644 LVDS标准工业温度范围:−40°C至+85°C 产品详情 ADN4662是一款单通道、CMOS、低压差分信号(LVDS)线 MHz)以上的数据速率,功耗超低。它采用直通式引脚排列,便于PCB布局以及输入与输出信号分离。             该器件接受低压(典型值310 mV)差分输入信号,并将其转换为单端3 V TTL/ CMOS逻辑电平。ADN4662及其配套驱动器ADN4661为高速点对点数据传输提供一种新的解决方案,可以代替射极耦合逻辑(ECL)或正射极耦合逻辑(PECL),功耗则更低。              应用点对点数据传输多分支总线时钟分配网络背板接收器 方框图...

  和特点 输出引脚提供±15 kV ESD(静电放电)保护开关速率:400 Mbps (200 MHz)流通引脚排列简化印制电路板(PCB)布线 ps(典型值)差分偏移:400 ps(最大值)传播延迟:1.7 ns(最大值)电源电压:3.3 V 欲了解更多信息,请参考数据手册 产品详情 ADN4667是一款四通道CMOS低压差分信号(LVDS)线 Mbps以上的数据速率(200MHz)和超低功耗。它具有流通引脚,可以轻松实现印制电路板布局以及输入与输出信号的分离。 ADN4667接收低压TTL/CMOS逻辑信号,并将其转换为一个差分电流输出信号,来驱动双绞线等传输媒介,输出电流的典型值为±3.1 mA。传输信号在接收端的终端电阻上产生典型值为±310 mV的差分电压。然后再通过ADN4668等LVDS接收器转换为TTL/CMOS逻辑电平。ADN4667还提供高电平和低电平有效的使能/禁用输入(EN和/EN)。这些输入控制全部的4个驱动器,并在禁用状态关闭电流输出,以将待机功耗降低至10 mW(典型值)。ADN4667及与其配合使用的LVDS接收器ADN4668,可为高速点对点数据传输提供全新的解决方案,并为发射极耦合逻辑(ECL)或正电压射极耦合逻...

  和特点 输出引脚提供±15 kV ESD保护转换速率:400 Mbps (200 MHz)直通式引脚排列可简化PCB布局通道间偏斜:100 ps(典型值)传播延迟:2.5 ns(最大值)3.3 V电源关断时为高阻抗输出低功耗:3 mW(静态典型值)与现有5 V LVDS驱动器兼容接受小摆幅(典型值310 mV)差分信号电平支持开路、短路和端接输入故障安全功能阈值区间:0 V至−100 mV 产品详情 ADN4664是一款双通道、CMOS、低压差分信号(LVDS)线 MHz)以上的数据速率,功耗超低。它采用直通式引脚排列,便于PCB布局以及输入与输出信号分离。该器件接受低压(典型值310 mV)差分输入信号,并将其转换为单端3 V TTL/ CMOS逻辑电平。              ADN4664及其配套LVDS驱动器ADN4663为高速点对点数据传输提供一种新的解决方案,可以代替射极耦合逻辑(ECL)或正射极耦合逻辑(PECL),功耗则更低。          应用点对点数据传输多分支总线时钟分配网络背板接收器 方框图...

  和特点 输出引脚提供±15 kV ESD保护转换速率:400 Mbps (200 MHz)差分偏斜:100 ps(典型值)差分偏斜:400 ps(最大值)传播延迟:2 ns(最大值)3.3 V电源差分信号:±350 mV低功耗:13 mW(典型值)与现有5 V LVDS接收器兼容关断时为高阻抗LVDS输出符合TIA/EIA-644 LVDS标准欲了解更多特性,请参考数据手册 产品详情 ADN4665是一款四通道、CMOS、低压差分信号(LVDS)线 MHz)以上的数据速率,功耗超低。     该器件接受低压TTL/CMOS逻辑信号,并将其转换成典型值为±3.5 mA的差分电流输出,以便驱动双绞线电缆等传输介质。所传输的信号在接收端的端接电阻上产生典型值为±350 mV的差分电压,然后由LVDS接收器将其转换为TTL/CMOS逻辑电平。     ADN4665还提供高电平有效和低电平有效使能/禁用输入(EN和EN)。这些输入控制所有四个驱动器,并在禁用状态下关闭电流输出,将静态功耗降至典型值10 mW。ADN4665为高速点对点数据传输提供一种新的解决方案,可以代替射极耦合逻辑(ECL)或正射极耦合逻辑(PECL),功耗则更低。         应用背板...

  和特点 High Common-Mode RejectionDC: 100 dB typ60 Hz: 100 dB typ20 kHz: 70 dB typ40 kHz: 62 dB typ Low Distortion: 0.001% typ Fast Slew Rate: 9.5 V/µs typ Wide Bandwidth: 3 MHz typ Low Cost Complements SSM2142 Differential Line Driver产品详情 SSM2141是一款集成式差分放大器,用于接收平衡线路输入,适合要求高抗扰度和最佳共模抑制的音频应用。该器件的共模抑制(CMR)性能通常可以达到100 dB,而利用四个现有精密电阻的运算放大器实施方案,通常共模抑制只能达到40 dB,不能满足高性能音频的要求。SSM2141通过保持9.5 V/µs的高压摆率和高开环增益来实现低失真性能。在整个音频带宽内,其失线与平衡线互为补充。这些器件组合在一起可构成一个完全集成的解决方案,能够实现音频信号的等效变压器平衡,而不会有失真、电磁辐射(EMI)场和高成本等问题。SSM2141的其它应用包括信号求和、差分前置放大器和600 Ω低失真缓冲放大器。如需增益G = 1/2的类似性能器件,请参考SSM2143。 方框图...

  和特点 高共模抑制 DC: 90 dB(典型值) 60 Hz: 90 dB(典型值) 20 kHz: 85 dB(典型值) 超低总谐波失线 kHz) 快速压摆率: 10 V/ms(典型值) 宽带宽: 7 MHz(典型值,G = 1/2) 提供两个增益级: G = 1/2或2 低成本 产品详情 SSM2143是一款集成式差分放大器,用于接收平衡线路输入,适合要求对共模噪声有高抗扰度的音频应用。该器件通过对电阻进行激光调整,使之达到优于0.005%的精度,从而实现典型值为90 dB的共模抑制(CMR)。                                    该器件的其它特性包括10 V/µs的压摆率和宽带宽。在整个音频频段内,总谐波失线%,即使驱动低阻抗负载时也是如此。SSM2143输入级设计用于处理高达+28 dBu的输入信号(G = 1/2)。虽然该器件主要针对G = 1/2的应用,但通过反接+IN/-IN和SENSE/REFERENCE,也可以实现2倍增益。采用增益为1/2的配置时,SSM2143与平衡线可提供全集成式单位增益解决方案,能够在长电缆上驱动音频信号。如需增益G = 1的类似性能器件,请参考SSM2141。 方...

  和特点 接收器输入引脚提供±8 kV ESD IEC 61000-4-2接触放电保护 转换速率:400 Mbps (200 MHz) 通道间偏斜:100 ps(典型值) 差分偏斜:100 ps(典型值) 传播延迟:3.3 ns(最大值) 3.3 V 电源 关断时为高阻抗输出 欲了解更多特性,请参考数据手册。产品详情 ADN4666是一款四通道、CMOS、低压差分信号(LVDS)线 MHz)以上的数据速率,功耗超低。     该器件接受低压(典型值350 mV)差分输入信号,并将其转换为单端3 V TTL/ CMOS逻辑电平。       ADN4666还提供高电平有效和低电平有效使能/禁用输入(EN和EN),用来控制所有四个接收器。这些输入可禁用接收器,将输出切换至高阻抗状态。因此,一个或多个ADN4666器件的输出可以多路复用,将静态功耗降至典型值10 mW。    ADN4666及其配套驱动器ADN4665为高速点对点数据传输提供一种新的解决方案,可以代替射极耦合逻辑(ECL)或正射极耦合逻辑(PECL),功耗则更低。   应用点对点数据传输多分支总线时钟分配网络背板接收器 方框图...

  INA1651 SoundPlus™™ 高共模抑制、低失真差分线(单通道)SoundPlus™音频线dB的超高共模抑制比(CMRR),同时对于22dBu信号电平可在1kHz时保持-120dB的超低THD + N.片上电阻器的高精度匹配特性为INA165x器件提供了出色的CMRR性能。这些电阻器具有远远优于外部组件的匹配特性,并且不受印刷电路板(PCB)布局所导致的失配问题的影响。不同于其他线x CMRR在额定温度范围内能保持特性不变,经生产测试可在各种应用中提供始终如一的性能。 INA165x器件支持±2.25V到±18V的宽电源电压范围,电源电流为10.5mA。除线路接收器通道之外,INA165x器件还包含一个缓冲的中间电压基准输出,因此可将其配置为用于双电源或单电源应用。中间电源输出可用作信号链中其他模拟电路的偏置电压。这些器件的额定温度范围为-40°C至125°C。 特性 高共模抑制: 91dB(典型值) 高输入阻抗:1MΩ差分 超低噪声:-104.7dBu,未加权 超低总谐波失线dB THD + N(22dBu,22kHz带宽) 高带宽:2.7MHz 低静态电流:6mA(INA1651,典型值) 短路保护 集成电磁干扰(EMI)滤波器 宽电源电压...

  FPC202 双端口控制器用作低速信号聚合器,适用于 SFP、QSFP 和 Mini-SAS HD 等通用端口类型。FPC202 能够跨两个端口聚合所有低速控制和 I2C 信号,并为主机提供一个易于使用的管理接口(I2C 或 SPI)。可以在高端口数情形中使用多个 FPC202 应用 中使用多个 FPC402,通过一个公共控制接口连接到主机。FPC202 所采用的设计允许将其放置在 PCB 底部、压合连接器下方,由此可简化布线。凭借这种本地控制端口低速信号的方法,可以使用 I/O 数更少的控制器件(FPGA、CPLD 和 MCU)并减少布线层拥塞,从而降低系统物料清单 (BOM) 成本。FPC202 能够与标准的 SFF-8431、SFF-8436 和 SFF-8449 低速管理接口(包括连接每个端口的专用 100/400kHz I2C 接口)兼容。该器件还提供有其他通用引脚来驱动端口状态 LED 或控制电源开关。LED 驱动器 具有 可编程闪烁和调光等便捷功能。连接主机控制器的接口可在 1.8V 至 3.3V 的单独电源电压下运行,以支持低压 I/O。对于每个端口,FPC202 总共具有四个 LED 驱动器、12 个通用 I/O 和两个下行 I2C 总线。这组扩展的 I/O 允许控制系统内的其...

  FPC401四端口控制器用作低速信号聚合器,适用于SFP +,QSFP +和SAS等通用端口类型.FPC401能够跨四端口聚合所有低速控制和I2C信号,并为主机提供了一个方便使用的管理接口(I2C或SPI)。对于高端口数应用来说,可以搭配使用多个FPC401,而且同样能够为主机提供一个公共控制接口.FPC401所采用的设计允许放置在PCB底部的压合连接器下,这样方便布线。凭借这种本地控制端口低速信号的方法,可以使用IO数更少的控制器件(FPGA,CPLD,MCU)并减少布线层拥塞,从而降低系统物料清单(BOM)成本。 特性 支持跨四个端口进行控制信号管理和I2C聚合 结合多个FPC401可通过一个主机接口控制56个端口 无需使用分立式I2C多路复用器,LED驱动器和高引脚计数现场可编程门阵列(FPGA)/复杂可编程逻辑器件(CPLD)控制器件 通过处理接近端口的全部低速控制信号来降低PCB布线MHz)或SPI(高达10MHz)主机控制接口 从模块中自动预取用户指定的重要数据 单端口和多端口读/写延迟短:SPI模式<50μs,I2C模式<400μs 广播模式允许对所有FPC401控制器的全部端口...

  FPC402四端口控制器用作低速信号聚合器,适用于SFP,QSFP和Mini-SAS HD等通用端口类型.FPC402能够跨四个端口聚合所有低速控制和I2C信号,并为主机提供一个易于使用的管理接口(I2C或SPI)。您可以在高端口数应用中使用多个FPC402,通过一个公共控制接口连接到主机.FPC402所采用的设计允许放置在PCB底部,压合连接器下方,这样可以简化布线。凭借这种对端口中低速信号的本地控制方法,可以使用IO数更少的控制器件(FPGA,CPLD和MCU)并减少布线层拥塞,从而降低系统BOM成本。 FPC402能够与标准的SFF-8431,SFF-8436和SFF-8449低速管理接口(包括连接每个端口的专用100 /400kHz I2C接口)兼容。该器件还提供有其他通用引脚来驱动端口状态LED或控制电源开关.LED驱动器具有可编程闪烁和调光等便捷功能。连接主机制器的接口可以在1.8V至3.3V的单独电源电压下运行,以支持低压I /O. FPC402可以从每个模块中用户指定的寄存器中预取数据,这样方便主机通过一个快速I2C(速度高达1MHz)或SPI(速度高达10MHz)接口来访问数据。此外,当发生与受控端口相关联的用户可配置关键事件...

  这些集成电路设计用于TTL型数字系统和差分数据传输线之间的接口。它们对于派对线(数据总线)应用特别有用。这些电路类型中的每一种都在一个封装中组合了一个三态差分线路驱动器和一个差分输入线路接收器,两者都采用单个5V电源供电。驱动器输入和接收器输出兼容TTL。采用的驱动器类似于SN55113和SN75113三态线路驱动器,接收器类似于SN55115和SN75115线和SN75113驱动器以及SN55115和SN75115接收器的所有功能。驱动器在使能时执行双输入AND和NAND功能,或者在处于禁用状态时为负载提供高阻抗。驱动器输出级类似于TTL图腾柱输出,但是电流吸收部分与电流源部分分离,并且两者都被引出到相邻的封装端子。此功能允许用户选择在集电极开路输出配置中使用驱动器,或者通过将相邻的源和宿端子连接在一起,在正常的图腾柱输出配置中使用驱动器。 SN55116,SN75116和SN75118的接收器部分采用差分输入电路,共模电压范围为±15 V.内部130- 等效电阻,可选择用于端接传输线。频率响应控制端子允许用户降低接收器的速度或改善差分噪声抗扰度。 SN55116和SN75116的接收器具...


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